OpenVera

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OpenVera是一種硬體驗證語言，它由新思科技研發和運營。該語言主要用於創建硬體系統的測試平台。OpenVera是作為IEEE 1800標準的SystemVerilog的一個基礎部分，許多從事半導體集成電路設計、系統級設計、IP核設計以及電子設計自動化的人員都受益於此。

相關條目

SystemVerilog

外部連結

http://www.open-vera.com/（頁面存檔備份，存於網際網路檔案館）
ASIC World Vera Tutorial（頁面存檔備份，存於網際網路檔案館）
Open Vera Tutorial

可程式化邏輯裝置

概念

硬體描述語言

Verilog
- A
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VHDL
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- VITAL（英語：VHDL-VITAL）
SystemVerilog
- DPI
SystemC
Altera硬體描述語言（英語：Altera Hardware Description Language）
Handel-C
屬性規範語言（英語：Property Specification Language）
統一電源格式（英語：Unified Power Format）
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高階布林表達式語言（英語：Advanced Boolean Expression Language）
可程式化陣列邏輯（CUPL）
OpenVera
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MyHDL（英語：MyHDL）
JHDL
ELLA (程式語言)（英語：ELLA (programming language)）

公司

Accellera（英語：Accellera）
Actel（英語：Actel）
Achronix（英語：Achronix）
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Aldec（英語：Aldec）
Atmel
終止式（Cadence）
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Duolog（英語：Duolog）
Forte設計系統（英語：Forte Design Systems）
英特爾
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Lattice半導體（英語：Lattice Semiconductor）
國家半導體
明導國際
Microsemi（英語：Microsemi）
西格尼蒂克
新思科技
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- Virage邏輯（英語：Virage Logic）
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硬體

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Virtex (FPGA)（英語：Virtex (FPGA)）

軟體

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Xilinx Vivado
ModelSim
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IP

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開源	Java最佳化處理器（英語：Java Optimized Processor） LatticeMico32（英語：LatticeMico32） OpenCores（英語：OpenCores） OpenRISC（英語：OpenRISC） OpenRISC 1200（英語：OpenRISC 1200） RISC-V Zet (hardware)（英語：Zet (hardware)）

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分類：

硬體驗證語言

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